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标题: Verilog 语言和VHDL 语言的对应程序 [打印本页]

作者: Fade_time    时间: 2014-2-21 10:37
标题: Verilog 语言和VHDL 语言的对应程序
    这是因仑工作室EN-DMCU单片机开发系统中CPLD学习板的一些实验,既有Verilog HDL语言,也有与其对照的VHDl语言,最终实现的功能是一样的,大家可以参考一下,观察两种语法的不同。
    Verilog HDL语言部分:
        [attach]488[/attach]
    VHDL语言部分:
        [attach]489[/attach]





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